寫在前面 FPGA基礎(chǔ)知識(shí)極簡(jiǎn)教程（9）講到了七段數(shù)碼管的顯示Verilog設(shè)計(jì)，我們都知道续语，要在數(shù)碼管上顯示的數(shù)字厅瞎，使用BCD編碼是具有優(yōu)勢(shì)的（或者是最正確的）。拿數(shù)字時(shí)鐘...
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FPGA基礎(chǔ)知識(shí)極簡(jiǎn)教程（10）二進(jìn)制到BCD轉(zhuǎn)換算法
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FPGA基礎(chǔ)知識(shí)極簡(jiǎn)教程（9）七段數(shù)碼管顯示的Verilog簡(jiǎn)單設(shè)計(jì)
寫在前面 作為FPGA的基礎(chǔ)知識(shí)教程怎么能少得了這個(gè)簡(jiǎn)單的實(shí)際應(yīng)用七段數(shù)碼管顯示戳寸，本篇博文算得上是對(duì)以往這個(gè)話題的一個(gè)總結(jié)吧木蹬！注：數(shù)碼管本身是七段句喷，但是加上小數(shù)點(diǎn)之后就是八段...
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FPGA基礎(chǔ)知識(shí)極簡(jiǎn)教程（8）詳解三態(tài)緩沖器
寫在前面 下面用舉例子的方式引出三態(tài)門包帚，內(nèi)容過(guò)長(zhǎng)，大家可直接跳過(guò)运吓，進(jìn)入正文渴邦！ 三態(tài)門在FPGA以及ASIC設(shè)計(jì)中十分常用疯趟，隨便舉一個(gè)例子，在RAM的設(shè)計(jì)中（無(wú)論是同步讀寫RA...
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Verilog設(shè)計(jì)實(shí)例（7）基于Verilog的數(shù)字電子鐘設(shè)計(jì)
寫在前面 前段時(shí)間谋梭，有幾個(gè)小伙伴向我請(qǐng)教數(shù)字電子鐘設(shè)計(jì)的問(wèn)題信峻，這個(gè)問(wèn)題我在之前的BCD計(jì)數(shù)器以及數(shù)碼管顯示問(wèn)題中已經(jīng)分開(kāi)談過(guò)了，既然大家還有需求瓮床，不妨在這里集中總結(jié)一下盹舞！ 個(gè)...
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FPGA基礎(chǔ)知識(shí)極簡(jiǎn)教程（7）詳解亞穩(wěn)態(tài)與跨時(shí)鐘域傳輸
寫在前面 這篇文章主要是對(duì)過(guò)去對(duì)于亞穩(wěn)態(tài)以及跨時(shí)鐘域傳輸問(wèn)題的一次總結(jié)，作為這個(gè)系列博文的一次梳理吧隘庄。注：微信公眾號(hào)也會(huì)更新踢步，歡迎大家關(guān)注，我有了新文章會(huì)通過(guò)微信公眾號(hào)推送通...
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FPGA基礎(chǔ)知識(shí)極簡(jiǎn)教程（6）UART通信與移位寄存器的應(yīng)用寫在前面 相關(guān)博文1：詳解移位寄存器 相關(guān)博文2：uart的一些相關(guān)博客 個(gè)人微信公眾號(hào)： FPGA LAB 個(gè)人博客首頁(yè) 注：學(xué)習(xí)交流使用丑掺！ 相關(guān)博文1單獨(dú)介紹了各種類型的...
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Verilog設(shè)計(jì)實(shí)例（2）一步一步實(shí)現(xiàn)一個(gè)多功能通用計(jì)數(shù)器
寫在前面 相關(guān)博文博客首頁(yè)注：學(xué)習(xí)交流使用获印！ 正文 多功能計(jì)數(shù)器，英文名為：Versatile Counter街州；所謂多功能兼丰，這里包括二進(jìn)制計(jì)數(shù)，格雷碼計(jì)數(shù)以及線性反饋移位寄存...
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Verilog設(shè)計(jì)實(shí)例（1）線性反饋移位寄存器（LFSR）
寫在前面 相關(guān)博文博客首頁(yè)注：學(xué)習(xí)交流使用唆缴！ 正文 原理 線性反饋移位寄存器（LFSR）的英文全稱為：Linear Feedback Shift Register鳍征。賽靈思公司...
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FPGA基礎(chǔ)知識(shí)極簡(jiǎn)教程（1）從布爾代數(shù)到觸發(fā)器
寫在前面 個(gè)人博客首頁(yè) 注：學(xué)習(xí)交流使用！ 從初學(xué)者對(duì)數(shù)字設(shè)計(jì)的疑問(wèn)面徽？到什么是FPGA艳丛？什么是ASIC？在到布爾代數(shù)如何在FPGA內(nèi)部實(shí)現(xiàn)斗忌？最后到數(shù)字設(shè)計(jì)的核心元件觸發(fā)器质礼？本...
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FPGA基礎(chǔ)知識(shí)極簡(jiǎn)教程（4）從FIFO設(shè)計(jì)講起之異步FIFO篇
寫在前面 一開(kāi)始是想既然是極簡(jiǎn)教程，就應(yīng)該只給出FIFO的概念织阳，沒(méi)想到還是給出了同步以及異步FIFO的設(shè)計(jì)眶蕉，要不然總感覺(jué)內(nèi)容不完整，也好唧躲，自己設(shè)計(jì)的FIFO模塊不用去擔(dān)心因I...