發(fā)簡信
IP屬地：上海
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面向對象的陳年舊事
本文首發(fā)于微信公眾號“芯片學堂”，作者JKZHAN 面向對象編程（Object-oriented programming, OOP）是一種成熟的...
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SystemVerilog高效仿真技巧
本文首發(fā)于微信公眾號“芯片學堂”婿禽，作者JKZHAN 做動態(tài)仿真驗證通常會遇到要等待仿真結果的情況赏僧，特別是在調試某個測試用例的時候。很多時候扭倾，工程...
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SystemVerilog面向對象
本文首發(fā)于微信公眾號“芯片學堂”次哈，作者JKZHAN 分享筆記，一張大圖涵蓋絕大部分SystemVerilog OOP干貨吆录！ 面向對象編程（OOP...
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SystemVerilog接口
本文首發(fā)于微信公眾號“芯片學堂”窑滞，作者JKZHAN 接口（interface）是SV引入的很重要的特性，目前在絕大多數驗證環(huán)境或者設計中都會出現(xiàn)...
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SystemVerilog回調函數
本文首發(fā)于微信公眾號“芯片學堂”，作者JKZHAN 回調（callback）是一種在很多編程語言中都會使用的編程技巧哀卫。這算是一個感性的印象巨坊。關于...
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SystemVerilog多線程
本文首發(fā)于微信公眾號“芯片學堂”，作者JKZHAN 多線程此改、并發(fā)趾撵、并行計算等這些概念我們在很多計算機相關的領域都會聽到。具體去看共啃，并行計算是一個...
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SystemVerilog隨機方法
本文首發(fā)于微信公眾號“芯片學堂”占调，作者JKZHAN 我習慣將驗證空間理解為：驗證中原則上需要覆蓋的芯片所有有可能出現(xiàn)的工作狀態(tài)的集合。為了探索這...
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SystemVerilog隨機約束
本文首發(fā)于微信公眾號“芯片學堂”移剪，作者JKZHAN 上一篇文章《暗藏玄機的SV隨機化》介紹了SystemVerilog的各種隨機化方法究珊，本文將在...
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SystemVerilog結構體
本文首發(fā)于微信公眾號“芯片學堂”，作者JKZHAN 在上一篇文章《SystemVerilog枚舉》中纵苛，介紹了枚舉類型的本質和使用語法剿涮。本文接著介...